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高速先生成員--黃剛 又是一個聽起來匪夷所思的案例！本來是一個很平常的工作日下午，Chris突然收到一個最近合作比較多的客戶發過來的信息，瞬間打破了這難得的平靜。 
聽到“詭異”的Chris頓時有了興致，有多詭異呢？然后客戶接著往下說： 
1拖4的DDR4通道能跑通3200Mbps是個好事情啊，基本上算是拉滿來使用了啊。然后喜歡分兩段來說話的客戶終于說出來詭異的地方了…… 
啊。。。這？客戶其實也比較實誠，就直接說，這不內存顆粒價格漲得猛嘛，所以就先在現在的這個板子上試試減少一半顆粒的場景能不能跑，如果能跑，下個版本就改成1拖2的通道了。聽起來客戶的這個做法還是能解釋的，關鍵是客戶真的這么去做了，只貼2個顆粒反倒跑不起來啦！ 
既然客戶找到了Chris，Chris本身也有點興趣，那就當一個debug的項目去幫客戶研究下咯。于是詳細的詢問客戶貼顆粒的前后情況。在客戶描述完之后，Chris就了解了客戶的測試過程了。 板子是一個1拖4的DDR4通道，采用正反貼的設計方式，如下所示： 
客戶第一次用的時候就是4個顆粒都貼上來測試，在這種情況下，4個顆粒的這個DDR通道能跑到3200Mbps的速率，very的good…… 
然后客戶就用起了“省錢”模式，只貼了表層的2個顆粒，底層的2個顆粒就不貼的， 如下所示。然后測試結果就像客戶前面說的，就跑不上3200Mbps了…… 
是啊，為什么呢？貼少2個顆粒正常來說負載更少了，效果應該更好才對��！當然，很多情況下DDR的性能預測是真的沒有高速信號那么直觀，能一眼就看出問題所在。于是幫人幫到底唄，Chris干脆就對這個DDR4通道做個仿真好了。 
對！DDR的設計基本上很難用經驗來預測結果，一個精確的仿真的確是最好的解決方案。首先我們看看4個顆粒全貼的仿真結果。下圖分別是每個顆粒的地址信號的眼圖： 
從4個顆粒全貼的結果來看，無論是前面的2個顆粒還是后面的2個顆粒，眼圖結果還是ok的，也能側面反映到全貼顆�？梢耘芡ǖ那闆r。 好，關鍵的一步來了，如果像客戶那樣，只貼正面2個顆粒，不貼背面2個顆粒的話，眼圖結果又會是怎么樣的呢？這里就不賣關子了，直接給出眼圖仿真結果： 
是不是很驚訝，從仿真結果來看，主要是由于第一個正面的顆粒的信號質量嚴重拖了后腿，導致客戶只貼正面2個顆粒測試時跑不到3200Mbps。 
所以說，DDR通道的設計是真的很難預測，出現類似這種詭異的測試結果也慢慢見怪不怪了。尤其是遇到了1拖多的顆粒，又需要跑到一個比較高的速率時，往往設計時很難把握的，這個時候通過一個精度高的仿真是真的能解決很多問題哦！ 仿真結果是證明了這個測試問題，但是Chris的這個客戶也想知道到底是什么原因導致了這個case的1拖4全貼信號質量好，只貼正面的2個顆粒信號質量反而差�。「魑环劢z你們也想知道嗎？ 
問題：本文的這個案例，到底為什么貼少一半的顆粒信號質量反而差那么多呢？歡迎大家各抒己見哈。 關于一博： 一博科技成立于2003年3月，深圳創業板上市公司，專注于高速PCB設計、SI/PI仿真分析等技術服務，并為研發樣機及批量生產提供高品質、短交期的PCB制板與PCBA生產服務。致力于打造一流的硬件創新平臺，加快電子產品的硬件創新進程，提升產品質量。
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