quartus和modelsim聯(lián)合仿真問題

ID:1091824 · 發(fā)表于 2023-8-23 17:01

quartus調(diào)用modelsim后出現(xiàn)如下錯誤，求解

ID:1091824 · 發(fā)表于 2023-8-25 14:07

求大佬明示

ID:320306 · 發(fā)表于 2023-8-25 16:42

幫頂，這個問題比較專業(yè)，建議轉(zhuǎn)到FPGA專欄去問！

ID:1091824 · 發(fā)表于 2023-8-25 18:30

zsyzdx 發(fā)表于 2023-8-25 16:42
幫頂，這個問題比較專業(yè)，建議轉(zhuǎn)到FPGA專欄去問！

好的謝謝

ID:1085441 · 發(fā)表于 2023-8-25 20:58

網(wǎng)上搜了一下，是這樣
“No extended dataflow"，就是外部輸入的數(shù)據(jù)流！看下你的模塊名和所編寫V文件的名字是否一致，還有就是仿真的時候調(diào)用TESTBENCH測試代碼時的名字可否寫錯了。把這些小問題注意了，應該就OK了。

不管怎樣，不能進入仿真時，很大可能性就是測試代碼編寫有錯誤，邏輯、名稱等等，

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