計數器類的電路設計思路求解

ID:1072587 · 發表于 2023-4-18 21:15

我現在在設計一些計數器類的電路的時候不知道該以怎么個思路去做，求一個思路，謝謝各位大佬

功能要求：輸出端Q2、Q1、Q0 由高到低組成狀態S(Q2Q1Q0)，初始CO 為 0。 CP 上升沿計數，每次計數 S 的值增加 1，S 為(111)2時計數后變為(000)2，計數次數達到進制值后 S變為初始狀態S0，同時進位CO變為1。初始狀態S0由比賽現場裁判長抽取的任務參數確定，進制值由比賽現場裁判長抽取的任務參數從3~8 之中確定。

如下圖所示，現場抽取初始狀態 S0=(110)2，現場抽取進制值為 4 進制，初始CO為0；則第一個CP上升沿到來后， S狀態值變為(111)2，CO仍為0；第二個CP上升沿到來后，S狀態值變為(000)2，CO仍為0；第三個CP上升沿到來后，S狀態值變為(001)2，CO仍為0；第四個 CP 上升沿到來后，S 狀態值變回初始狀態(110)2，CO 變為 1；第五個CP上升沿到來后，S狀態值變為(111)2，CO變回0；以此類推，繼續循環進行4進制計數。

ID:235200 · 發表于 2023-4-18 22:54

可用可半裝載初值的4位二進制計數器如74LS161通過邏輯電路控制裝載引腳LD，D3D2D1D0設置所需開始的初始值，CP脈沖可用NE555芯片構成多諧電路產生。

ID:1034262 · 發表于 2023-4-18 23:09

根據最原始的要求，設計邏輯，然后簡化邏輯，設計電路。

ID:1063163 · 發表于 2023-4-19 16:33

很久以前，在一所技術學校，我做了一個類似的“數字機器”，其中的代碼是亂序給出的。
理論。
總體思路是：
- 當前代碼存儲在一組時鐘 D 觸發器中（因為操作發生在脈沖的邊緣）；
- “代碼轉換器”的輸入連接到 D 觸發器的輸出；
- D觸發器的輸入連接到“代碼轉換器”的輸出；
- 下一個代碼由“轉碼器”準備，所需代碼在下一個脈沖前沿“寫入”D 觸發器。
“轉碼器”是一個小容量的可編程存儲芯片（我只有 32 字節）。
實用的解決方案。
在您的情況下，您將需要 3 個時鐘 D 型觸發器和一個 eprom 芯片（如 28C16 或類似芯片，我找不到更少的）。
D 觸發器的輸出 Q1、Q2、Q3 連接到地址輸入 ADR0、ADR1、ADR2 eprom。
輸出 DATA0、DATA1、DATA2 eprom 連接到 D 觸發器 D1、D2、D3 的輸入。
讓DATA7 eprom輸出為“CO”信號（“傳輸輸出”）
在地址 000 處的 eprom 中，我們寫入二進制 0000`0001（即在下一個周期，我們“傳遞”到代碼 001 和 CO=0），然后：
- 在地址 001 我們寫入二進制 1000`0110（即在下一個周期我們“傳遞”到代碼 110 和 CO = 1）
- 在地址 110，我們寫入二進制 0000`0111（即在下一個周期，我們“傳遞”到代碼 111 并且 CO = 0）
- 在地址 111，我們寫入二進制 0000`0000（即在下一個周期，我們“傳遞”到代碼 000 和 CO = 0）。
對于所有其他 eprom 地址，必須寫入二進制 0000`0000，以便“數字機器”從“禁止”（非工作）狀態“返回”到已知的初始狀態。

這種方法可能看起來過于復雜，但實際上它允許您實現任何（!!）“數字機器”并且非常容易實現（尤其是在現代 FPGA 上）。

（對不起我的語言 - 機器翻譯并不完美）

ID:123289 · 發表于 2023-4-20 16:30

畫出真值表，列出卡諾圖，寫出邏輯關系式，畫圖。

ID:1073249 · 發表于 2023-4-23 23:34

用預置數計數器，就可以實現。芯片型號可以百度。

ID:1072587 · 發表于 2023-8-22 15:46

大佬們，是這樣的，這邊要求的是用觸發器級去做，就挺難搞，以前沒怎么碰過，能再給個思路嗎

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計數器類的電路設計思路求解