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數電中,如何克服懸空的干擾

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ID:376780 發表于 2018-7-21 18:05 | 顯示全部樓層 |閱讀模式
數電中,如何克服懸空的干擾
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ID:376814 發表于 2018-7-21 18:59 | 顯示全部樓層
將IO口接地。
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ID:7485 發表于 2018-7-21 21:36 | 顯示全部樓層
就是不讓他懸空。
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ID:111634 發表于 2018-7-22 09:08 | 顯示全部樓層
本帖最后由 zl2168 于 2018-7-22 15:47 編輯

你的問題不是一二句話能說清的,介紹你2本書,上面有答案,自己去看吧!
《數字電子技術基礎》(ISBN 978-7-111-21516-5機械工業出版社

《數字電子學習指導與習題解答》(ISBN 978-7-111-21517-2機械工業出版社該書中有:

2.2.2 門電路外部特性和主要參數
⒈ 電壓傳輸特性
⑴ 電壓傳輸特性
⑵ 常用名詞和參數
① 輸出高電平UOH。
② 輸出低電平UOL。
③ 閾值電壓UTH。
④ 關門電平UOFF。
關門電平UOFF。UOFF是TTL與非門電路輸出高電平時,輸入端允許輸入的最大低電平值。即為保證TTL與非門輸出高電平,應滿足uI≤UOFF,UOFF的確切數值因每一器件而異。一般,手冊中給出輸入低電平最大值UILmax代替UOFF。74LS系列門電路UILmax=0.8V。
⑤ 開門電平UON。
開門電平UON。UON是TTL與非門電路輸出低電平時,輸入端允許輸入的最小高電平值。即為保證TTL與非門輸出低電平,應滿足uI≥UON,UON的確切數值因每一器件而異。一般,手冊中給出輸入高電平最小值UIHmin代替UON。74LS系列門電路UIHmin=2V。

⑥ 噪聲容限。
⒉ 輸入特性
⑴ 輸入伏安特性
⑵ 輸入負載特性
圖2-19為74LS系列門電路輸入負載特性。RI較小時,uI相當于輸入低電平,與非門處于關門狀態;RI較大時,uI相當于輸入高電平,與非門處于開門狀態。即:若需保持uI為低電平(uI<UILmax),RI不能過大,須RI<ROFF。ROFF稱為關門電阻,是使與非門保持關門狀態的RI最大值。74LS系列門電路ROFF ≈4.2kΩ。當RI足夠大時,uI≈1V保持基本不變,如圖2-11中,uI =uBE1+uBE5)-uVD3≈1.4-0.4=1V。相當于輸入高電平,與非門處于開門狀態。即:若需保持uI相當于輸入高電平,RI不能過小,須RI>RON。RON稱為開門電阻,是使與非門保持開門狀態的RI最小值。74LS系列門電路RON ≈6.3kΩ。
⒊ 輸出特性
⑴ 拉電流負載輸出特性
⑵ 灌電流負載輸出特性
⒋ 門電路的主要參數
⑴ 靜態動耗PD
⑵ 傳輸延遲時間tpd
⒌ 不同系列的TTL門電路
⑴ 74系列(基本型)
⑵ 74L系列(低功耗)
⑶ 74H系列(高速)
⑷ 74S系列(肖特基)
⑸ 74LS系列(低功耗肖特基)
⑹ 74AS系列(先進高速肖特基)
⑺ 74ALS系列(先進低功耗肖特基)
復習思考題
2.30 CMOS門電路不用的輸入端能否懸空?在這一點上與TTL門電路有什么不同?
2.5  習題
2.91 已知74LS系列三輸入端與非門電路如2-48所示,其中2個輸入端分別接輸入信號AB,另一個輸入端為多余引腳。試分析電路中多余引腳的接法是否正確?
2.92 已知74LS系列三輸入端或非門電路如2-49所示,其中2個輸入端分別接輸入信號A、B,另一個輸入端為多余引腳。試分析電路中多余引腳接法是否正確?
2.93 已知圖2-50電路中TTL門電路的ROFF=0.8kΩ,RON=2.5kΩ,試寫出輸出端Y1~Y4函數表達式。
2.94已知74LS系列三輸入端門電路如2-51所示,A、B為有效輸入信號,另一個輸入端為多余引腳。若要求電路輸出Y1~Y6按圖所求,試判斷電路接法是否正確?若有錯,試予以改正。
2.95 若圖2-48中與非門改成74HC系列或CMOS 4000系列,再判電路接法是否正確?
2.96 已知CMOS門電路如圖2-50所示,試重新寫出輸出端Y1~Y4函數表達式。
2.97 已知CMOS三輸入端門電路如圖2-51所示,試重新判斷電路接法是否正確?若有錯,試予以改正。
教輔書《數字電子學習指導與習題解答》與教材書《數字電子技術基礎》配套,習題都有詳解。 捕獲.PNG
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ID:308437 發表于 2018-7-22 09:40 | 顯示全部樓層
接一個下拉電阻,給一個確定的電平
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ID:364341 發表于 2018-7-22 15:28 | 顯示全部樓層
由于邏輯器件的內部結構,當它輸入引腳懸空時,相當于該引腳接了高電平。一般實際運用時,引腳不建議懸空,易受干擾。也稱為“浮空”。
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ID:377605 發表于 2018-7-22 22:47 | 顯示全部樓層
對于ttl電路進行串聯或者接地就行,但是對于cmos電路,將電路進行并聯或者接地就行
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ID:302217 發表于 2018-7-24 07:57 | 顯示全部樓層
輸出腳無所謂了,直接懸空好了;輸入腳一般最好接地或接V+。對于可設定情況,比如單片機,直接定義為輸出腳就好。
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ID:378319 發表于 2018-7-24 09:47 | 顯示全部樓層
接地或者接高電平
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ID:378582 發表于 2018-7-24 17:09 | 顯示全部樓層
接地,或者加個0歐電阻再回地,方便斷開
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