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基于FPGA的交通燈電子系統(tǒng)工程課程設(shè)計(jì)報(bào)告

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ID:365749 發(fā)表于 2018-7-5 17:48 | 顯示全部樓層 |閱讀模式
基于FPGA的交通燈設(shè)計(jì)
設(shè)計(jì)目的:
1、 掌握交通燈顯示原理。
2、 掌握交通燈顯示編程方法。
所需設(shè)備:
1、  帶有 quartusII 軟件的PC 機(jī)一臺(tái)。
2、  FPGA 實(shí)驗(yàn)箱以及電源線下載線。
設(shè)計(jì)要求:
1、 編程實(shí)現(xiàn)黃,紅,綠燈循環(huán)點(diǎn)亮。
2、 理解交通燈顯示原理。
原理:
四個(gè)方向的交通燈中,方向相對(duì)且同一顏色的燈是相連的,然后通過(guò)給高低電平,來(lái)控制通1
模塊符號(hào):

是交通燈模塊符號(hào)。
交通燈模塊符號(hào)
實(shí)驗(yàn)代碼:
module trffic_light(clk,light);

input clk;
output[5:0] light;

reg[5:0] light;
reg[50:0] cnt;
reg[3:0] cntm;

always@(posedge clk)
begin
    if(cnt>=50000000)
    begin
        cntm<=cntm+1;
        cnt<=0;
    end
    else
    begin
        cnt<=cnt+1;
    end
    if(cntm>=6)
    begin
        cntm<=0;
    end
end

always@(posedge clk)
begin
case(cntm)
        0:light<=6'b100100;//0
        1:light<=6'b001001;//1
        2:light<=6'b011000;//2
        3:light<=6'b000110;//3
        4:light<=6'b100100;//4
        5:light<=6'b001001;//5

        default:light<=6'b000000;
endcase
end
endmodule
步驟:
1、 打開 quartusII 開發(fā)環(huán)境,打開 ex18_traffic_light 的工程;
2、 編譯工程;
3、  連接好電源線,下載線接JTAG 接口,做好準(zhǔn)備工作。
4、  打開下載界面,導(dǎo)入.sof 文件,下載運(yùn)行,觀察效果。
顯示結(jié)果:
1、引腳配置
file:///C:/Users/%E6%96%AD%E7%AE%B4/AppData/Local/Temp/msohtmlclip1/01/clip_image003.jpg
2、生成電路
file:///C:/Users/%E6%96%AD%E7%AE%B4/AppData/Local/Temp/msohtmlclip1/01/clip_image005.jpg
3、結(jié)果
file:///C:/Users/%E6%96%AD%E7%AE%B4/AppData/Local/Temp/msohtmlclip1/01/clip_image007.jpg


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