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QuartusII設(shè)計的數(shù)字日歷附verilogHDL源程序

查看數(shù): 7132 | 評論數(shù): 5 | 收藏 4

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發(fā)布時間: 2020-11-4 20:39

正文摘要:

設(shè)計并制作一臺數(shù)字日歷。1.1.2 性能指標(biāo)要求 ① 用EDA的I/O設(shè)備和PLD芯片實現(xiàn)數(shù)字日歷的設(shè)計。② 數(shù)字日歷能夠顯示年、月、日、時、分和秒。③ 用EDA上的8只八段數(shù)碼管分兩屏分別顯示年、月、日和時、分、秒，即在 ...

回復(fù)

ID:808093 發(fā)表于 2022-11-27 15:00

兄弟，用的什么芯片

ID:57657 發(fā)表于 2021-12-17 13:21

gg0914 發(fā)表于 2021-5-17 23:46
圖上的管腳用的是什么芯片啊？

Verilog HDL是一種用來設(shè)計芯片的語言

ID:985182 發(fā)表于 2021-11-27 21:08

請問樓主可以分享一下文件嗎？

ID:921360 發(fā)表于 2021-5-17 23:46

圖上的管腳用的是什么芯片啊？

ID:827716 發(fā)表于 2020-12-2 23:44

看不懂仿真的時序圖

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