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verilog模塊封裝關于多位二進制變量的輸出連接問題

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MMJZ

發布時間: 2020-4-24 18:03

正文摘要:

verilog語言編寫的程序封裝成模塊，8位二進制變量輸出不能直接連接output，該怎樣連接輸出呢？圖片中的qs，qm，qh都是8位二進制，在仿真時采用2位十六進制輸出波形，這三個的output如何連接？

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