| 院（系） | 物理與電子信息學院 | 專 業(yè) | 電子信息工程 |
| 姓 名 | 李*儂 | 學 號 | 201200804044 |
| 設計題目 | 基于MATLAB的鎖相環(huán)電路設計 | ||
| 一、選題目的和意義 | |||
| 鎖相技術是一項重要的自動反饋控制技術，在許多方面得以廣泛應用，如通信、導航、廣播與電視通信、儀器儀表測量、數(shù)字信號處理及國防技術。鎖相環(huán)作為一個閉環(huán)的自動控制系統(tǒng)是一個非常重要的模塊。在現(xiàn)代集成電路中，它同時具備自動頻率控制和自動相位控制兩項技術，在頻率合成、時鐘恢復及信號的調制解調等系統(tǒng)有廣泛的應用，其輸出時鐘信號能自動跟蹤外部輸入時鐘信號的頻率及相位變化。 隨著集成電路朝著片上系統(tǒng)方向的發(fā)展，工藝尺寸的不斷縮小，以及芯片面積的不斷增加，從而導致芯片內(nèi)部各模塊間的互連延遲導致信號延遲的積累的現(xiàn)象愈加明顯，甚至引起由于時序錯誤而導致的電路功能異常。為了解決這一問題，論文中設計了一款基于集成技術的快速鎖定的鎖相環(huán)。 | |||
| 二、本選題在國內(nèi)外的研究現(xiàn)狀和發(fā)展趨勢 | |||
| 模擬鎖相環(huán)、數(shù)模混和的鎖相環(huán)和純數(shù)字鎖相環(huán)這三種，由于其各自都有優(yōu)點，目前這三種鎖相環(huán)井存于實際的產(chǎn)品，CMOS工藝以其低廉的成本在鎖相環(huán)市場中占有絕對的優(yōu)勢。目前高性能的PLL芯片主要集中在一些跨國公司手中。與國外大企業(yè)相比，國內(nèi)只有少數(shù)一些企業(yè)掌握高性能鎖相環(huán)技術。但是由于我國集成電路產(chǎn)業(yè)起步較晚與國外PLL技術的深厚沉積相比差距十分巨大。 早期，鎖相環(huán)專門用于高精度儀器中，但是隨著集成電路技術的發(fā)展，鎖相環(huán)逐步轉變?yōu)橛糜趥�人電子產(chǎn)品中。近年來，出現(xiàn)了全數(shù)字鎖相環(huán)，它在噪聲抗干擾方面具有很大優(yōu)勢。盡管鎖相環(huán)技術經(jīng)歷了數(shù)十年的發(fā)展取得了巨大的成功但是隨著工藝的不 斷進步，隨之產(chǎn)生的很多物理現(xiàn)象和問題都沒有完美的解釋。當前鎖相技術的理淪和應用仍然是科技工作者所關注的焦點之一。 | |||
| 三、課題設計方案 | |||
| 1. 查閱相關資料，搜集并檢索相關的技術資料與文獻，熟悉鎖相鎖電路的原理； 2. 查找相關書籍和教學視頻，熟練運用matlab仿真軟件； 3. 參考書籍或網(wǎng)絡資源，設計鎖相鎖電路； 4. 利用protel設計電路原理圖； 5. 對設計的電路原理圖進行修改，最終完成設計； | |||
| 四、計劃進度安排 | |||
| 第一階段（第一周至第二周）：確定研究課題，進行知識準備及資料收集，了解并熟悉課題內(nèi)容，了解并安裝相關軟件工具，寫出開題報告。 第二階段（第三周至第五周）：提出電路設計方案，根據(jù)設計方案，進行論文的大致整合，并寫出中期檢查報告。 第三階段（第六周至第十周）：繪制電路圖，并對各部分章節(jié)進行整理，經(jīng)進一步完善后，形成論文初稿。 第四階段（第十一周至第十二周）：根據(jù)指導意見和建議對論文進行修改和完善后形成論文終稿。 | |||
| 五、主要參考文獻 | |||
| 組長簽名： 年 月 日 | |||
| 畢業(yè)設計題目：基于MATLAB的鎖相環(huán)電路設計 | |||
| 學生姓名 | 李*儂 | 學 號 | 201200804044 |
| 指導教師 | 張晨 | 職 稱 | 講師 |
| 計劃完成時間： 2016年5月20日 | |||
| 畢業(yè)設計的進度計劃： 第一階段（第一周至第二周）：確定研究課題，進行知識準備及資料收集，了解并熟悉課題內(nèi)容，了解并安裝相關軟件工具，寫出開題報告。 第二階段（第三周至第五周）：提出電路設計方案，根據(jù)設計方案，進行論文的大致整合，并寫出中期檢查報告。 第三階段（第六周至第十周）：繪制電路圖，并對各部分章節(jié)進行整理，經(jīng)進一步完善后，形成論文初稿。 第四階段（第十一周至第十二周）：根據(jù)指導意見和建議對論文進行修改和完善后形成論文終稿。 | |||
| 完成情況： 學習了基于集成技術的快速鎖定鎖的有關知識，基本了解了鎖定鎖運行原理及電路主要組成部分。熟悉了怎樣完整的完成一個項目的制作。 | |||
| 指導教師評議 評議人： 年 月 日 | |||
| 備注： | |||
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