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標題:
CD4094時序圖理解陷入僵持,求指點
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作者:
戀舞
時間:
2022-3-15 15:19
標題:
CD4094時序圖理解陷入僵持,求指點
圖三.PNG
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2022-3-15 15:11 上傳
STROBE低電平鎖存,移8個數(shù)據(jù)后,STROBE拉高輸出。可是圖中STROBE開始為低,馬上就拉高了,拉高不是輸出嗎,這數(shù)據(jù)還沒鎖存啊,另外這里STROBE高電平維持了4個時鐘,拉低后馬上拉高,又是什么意思啊,不是為低的時候進行數(shù)據(jù)鎖存嗎,怎么跟我理解的相反了啊,求指點下,謝謝
作者:
188610329
時間:
2022-3-15 18:31
你要有 “沿” 這樣的概念,通常除了 OE 這種使能的端口,是維持一個高電平或者低電平的狀態(tài)來生效,大多數(shù)都是通過 上升沿或者下降沿 來生效的,就好像, CLK 其實真正 移位只是作用在由低拉高的一瞬間,STORB 其實也是一樣的道理。
作者:
名字不是重點
時間:
2022-3-15 23:52
你只要記住一點:在CLK的上升沿,將D上電平傳送到Q,這就是典型的“數(shù)據(jù)鎖存器“的工作時序。
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