AD7091R_cn.pdf
(1.25 MB, 下載次數(shù): 4)
yzwzfyz 發(fā)表于 2021-7-12 17:24
仔細(xì)讀手冊(cè):
1、數(shù)據(jù)是串行工作的,每位數(shù)據(jù)的切換是需要時(shí)間的,切換位數(shù)(CLK)不要超過(guò)允許的時(shí)間。
...
5191 發(fā)表于 2021-7-13 11:36
stc不是有自帶ad嗎
glinfei 發(fā)表于 2021-7-13 16:09
看你發(fā)的手冊(cè)應(yīng)該在CLK下沿讀DO,但你程序?qū)懙氖巧涎刈x啊。
就這段 ad_clk = 1;
dat
Capta1nY 發(fā)表于 2021-7-15 10:46
問(wèn)一下各位大佬,有沒(méi)有可能是51的時(shí)鐘頻率不夠,我查到的用這個(gè)AD的都是FPGA和32的
glinfei 發(fā)表于 2021-7-15 11:12
我那天就想問(wèn),你手冊(cè)上給的最大讀取時(shí)間好短啊,比如T4 只有3ns,都不夠if用的,能否先把a(bǔ)d_do賦值個(gè)中 ...
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