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標(biāo)題: 學(xué)VHDL有意思嗎？ [打印本頁]

作者: f556 時(shí)間: 2019-11-15 10:10
標(biāo)題: 學(xué)VHDL有意思嗎？
看到外孫女在學(xué)VHDL，第一次知道有這東西，IDE看上去與keil、IAR相似，語法象C、VB的綜合體。FPGA是高性能高成本的，我不看好。認(rèn)為C更有用。
即便是考慮相同功能的語言，現(xiàn)在社會(huì)上Verilog與vhdl哪個(gè)用的比較多？網(wǎng)上的反應(yīng):用verilog多一些，查找資料也比較容易； vhdl也有用的，但是相對(duì)較少，verilog多；Verilog應(yīng)該比較多一點(diǎn)....
搜了一下VHDL，列出好好多優(yōu)點(diǎn)，什么缺點(diǎn)都沒有，想到了船小，有種給這完美東西打0.0分的沖動(dòng)。
想知道學(xué)VHDL有意思嗎？歡迎討論，謝謝！

作者: csmyldl 時(shí)間: 2019-11-15 12:27
既然存在，每一行都需要，也許你暫沒入這一行

作者: Y_G_G 時(shí)間: 2019-11-15 14:08
VHDL主要應(yīng)用在FPGA上
C應(yīng)用的地方就比較多
就嵌入式而言,有經(jīng)驗(yàn)的FPGA工程師目前的工資大多是20K左右,再往上就視能力而言了
你覺得有沒有用呢?

作者: oldwood_hmgh 時(shí)間: 2019-11-15 17:28
VHDL是美軍搞的一套東西，他的軍需電子產(chǎn)品來自各個(gè)不同的企業(yè)，擔(dān)心某家企業(yè)倒閉后找不到下家，要求提供商提供產(chǎn)品的時(shí)候必須用VHDL語言描述產(chǎn)品的結(jié)構(gòu)，以便能夠復(fù)制，后來成為了工業(yè)標(biāo)準(zhǔn)。
這個(gè)東西很有用，開發(fā)CPLD和FPGA，許多廠家的CAD軟件都支持。

作者: 不知道叫啥2020 時(shí)間: 2019-11-15 17:38
本人也曾經(jīng)學(xué)過VHDL，VHDL是當(dāng)年美國軍方開創(chuàng)的一種硬件編程語言，方便用于非常龐大的產(chǎn)品設(shè)計(jì)，穩(wěn)定性極佳，對(duì)FPGA技術(shù)有著深遠(yuǎn)的意義，Verilog是VHDL問世后，由美國一個(gè)民間的組織發(fā)明的，是為了彌補(bǔ)VHDL的短板，當(dāng)系統(tǒng)比較小的時(shí)候不需要像VHDL一樣寫那么繁雜的代碼，能節(jié)省時(shí)間和空間，目前市面上的芯片雖然已經(jīng)是琳瑯滿目五花八門了，能滿足大部分場景的應(yīng)用，但是用于一些特定的領(lǐng)域比如便攜式設(shè)備，由于本身的體積大小限定了不能讓你放那么多的芯片，這時(shí)候VHDL就派上用場了。綜上所訴，學(xué)習(xí)VHDL很有意思，也很有意義，且目前VHDL方面人才缺口較大，待遇高，是個(gè)不錯(cuò)的發(fā)展方向

作者: 小米熊724 時(shí)間: 2019-11-15 23:00
都很重要哈

作者: yzwzfyz 時(shí)間: 2019-11-16 08:45
你有老虎鉗子了，再要扳手有用嗎？
這的問題就是如此。
C與V都是軟件工具。

作者: wifingtta 時(shí)間: 2019-11-16 08:51
主要看做什么產(chǎn)品吧，各有各的優(yōu)點(diǎn)

作者: f556 時(shí)間: 2019-11-18 10:58

不知道叫啥2020 發(fā)表于 2019-11-15 17:38
本人也曾經(jīng)學(xué)過VHDL，VHDL是當(dāng)年美國軍方開創(chuàng)的一種硬件編程語言，方便用于非常龐大的產(chǎn)品設(shè)計(jì)，穩(wěn)定性極佳 ...

謝謝！長知識(shí)了，我是不想學(xué)這個(gè)了，僅會(huì)C、VB，自己業(yè)余玩玩。

作者: pxj0707 時(shí)間: 2019-11-19 15:23
目前接觸的是verilog多一些,但是個(gè)人感覺還是C用得比較多

作者: fly080 時(shí)間: 2019-11-19 16:38
只要感興趣喜歡就好

作者: 15051893833 時(shí)間: 2019-11-20 14:33
很有用的時(shí)設(shè)計(jì)數(shù)字電路的基礎(chǔ)技能

作者: 捷配PCB 時(shí)間: 2019-11-20 14:41
VHDL主要應(yīng)用在FPGA上 C應(yīng)用的地方就比較多就嵌入式而言,有經(jīng)驗(yàn)的FPGA工程師目前的工資大多是20K左右,再往上就視能力而言了你覺得有沒有用呢?

作者: xiaogongok 時(shí)間: 2019-11-21 11:06
有幫助

作者: Easom 時(shí)間: 2019-11-21 19:50
我覺得學(xué)習(xí)任何新知都是有意思的

作者: Emmanuel98 時(shí)間: 2019-11-21 23:10
我覺得可以對(duì)于你的技術(shù)錦上添花把，有一定幫助

作者: 1255230 時(shí)間: 2019-11-22 00:02
用C得多

作者: wc86110 時(shí)間: 2019-11-22 06:10
要是人家對(duì)高端芯片實(shí)行斷供措施，有意思也變沒意思

作者: f556 時(shí)間: 2019-11-22 09:09

wc86110 發(fā)表于 2019-11-22 06:10
要是人家對(duì)高端芯片實(shí)行斷供措施，有意思也變沒意思

很有見解，這事已經(jīng)發(fā)生過了，正如高通與中興，實(shí)際上好象還有很多斷供的。低端芯片有低端用途的龐大市場，好比TI 生產(chǎn)2kB flash 128B的MCU ，有人在用，我手上也有。

作者: 蜘蛛俠123456 時(shí)間: 2019-11-22 09:42
存在即為合理！什么都要好好學(xué)學(xué)習(xí)新的東西

作者: T_Trigger 時(shí)間: 2019-11-26 13:53
全稱是Verilog 硬件描述語言，兩者語言相差不多。但兩者定義不一樣，keil是鉗入式方向，怎么用好單片機(jī)芯片的。
VHDL是數(shù)字方向，通過代碼綜合成TTL級(jí)別的電路，也就是怎么設(shè)計(jì)芯片的。

作者: f556 時(shí)間: 2019-11-26 14:55
設(shè)計(jì)芯片!太高大上了，VHDL會(huì)高工資，看來真可能這樣，我感覺能用好芯片已經(jīng)不錯(cuò)了。

總體投票結(jié)果在我的想象之中，看來群眾的眼睛是看的清的。
再次感謝投票、回復(fù)！

作者: qq11qq1 時(shí)間: 2019-11-26 19:33
VHDL主要應(yīng)用在FPGA上
C應(yīng)用的地方就比較多
就嵌入式而言,有經(jīng)驗(yàn)的FPGA工程師目前的工資大多是20K左右,再往上就視能力而言了
你覺得有沒有用呢?

作者: svsdfweeef 時(shí)間: 2019-11-27 20:37
看自己愛好感興趣學(xué)

作者: rzhang52813 時(shí)間: 2019-11-28 09:35
我覺得c++比較好這個(gè)東西看個(gè)人吧因人而異

作者: 鄭漢松 時(shí)間: 2019-12-1 16:38
VHDL一般用在FPGA，要說的話FPGA比單片機(jī)屌多了

作者: 445556 時(shí)間: 2019-12-1 17:46
VHDL主要用于描述數(shù)字系統(tǒng)的結(jié)構(gòu)，行為，功能和接口。除了含有許多具有硬件特征的語句外，VHDL的語言形式、描述風(fēng)格以及語法是十分類似于一般的計(jì)算機(jī)高級(jí)語言。VHDL的程序結(jié)構(gòu)特點(diǎn)是將一項(xiàng)工程設(shè)計(jì)，或稱設(shè)計(jì)實(shí)體(可以是一個(gè)元件，一個(gè)電路模塊或一個(gè)系統(tǒng))分成外部(或稱可視部分,及端口)和內(nèi)部(或稱不可視部分)，既涉及實(shí)體的內(nèi)部功能和算法完成部分。在對(duì)一個(gè)設(shè)計(jì)實(shí)體定義了外部界面后，一旦其內(nèi)部開發(fā)完成后，其他的設(shè)計(jì)就可以直接調(diào)用這個(gè)實(shí)體。這種將設(shè)計(jì)實(shí)體分成內(nèi)外部分的概念是VHDL系統(tǒng)設(shè)計(jì)的基本點(diǎn)。

作者: 哎呀好氣好氣 時(shí)間: 2020-7-3 22:32
好像國內(nèi)用Verilog的多一些，知識(shí)多多益善

作者: TTQ001 時(shí)間: 2020-7-4 06:42
學(xué)習(xí)如何編程VHDL非常有趣。

作者: yang0214 時(shí)間: 2020-7-4 10:38
感興趣的話就覺得有意思，所以還是要先培養(yǎng)興趣愛好。

作者: liwenshi2012@16 時(shí)間: 2020-7-8 09:54
我覺得感興趣就可以去學(xué)，藝多不壓身

作者: iijjkk 時(shí)間: 2020-7-8 11:58
存在即合理！！！！

作者: 名字不是重點(diǎn) 時(shí)間: 2021-7-6 16:30
想學(xué)就學(xué)，不想學(xué)就不學(xué)，有什么好糾結(jié)的？每個(gè)人的條件不一樣、規(guī)劃不一樣，
想學(xué)的人沒有條件也能創(chuàng)造條件去學(xué)，不想學(xué)的哪怕有條件也不會(huì)看一眼。
哪能由別人來決定？全世界70E+人，只能有一個(gè)馬云，也只需要一個(gè)就足夠了。。
無聊的貼子

！

浪費(fèi)資源！
類似的還有：
想入門單片機(jī)，請(qǐng)問學(xué)PROPTEUS，還是學(xué)PROTEL？為什么？
學(xué)單片機(jī)的大部分都是大學(xué)以上文憑？
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目前對(duì)于小白來應(yīng)該先搞51單片機(jī)還是stm32？

我也真無聊，居然連翻10+頁來COPY這些。。。

作者: 正規(guī)007 時(shí)間: 2021-7-6 18:03
很難說，現(xiàn)在看似沒有的，只要你鉆研進(jìn)去了，若干年后說不定會(huì)起作用。當(dāng)年的某一個(gè)寶讓人感覺也是這個(gè)樣子！

作者: 4819142 時(shí)間: 2021-7-7 09:50
對(duì)我來說好陌生喲!

作者: TTQ001 時(shí)間: 2021-7-9 08:30
學(xué)習(xí)VHDL非常有用，而且報(bào)酬豐厚。

作者: acolorwolf 時(shí)間: 2021-7-9 10:09
沒意思，你會(huì)發(fā)現(xiàn)你根本用不上，純屬浪費(fèi)時(shí)間。為什么以前用得上現(xiàn)在用不上呢？因?yàn)橐郧皢纹瑱C(jī)功能弱，現(xiàn)在的ARM 32位單片機(jī)功能強(qiáng)大。不排除一些大公司繼續(xù)用FPGA，那你進(jìn)大公司有機(jī)會(huì)再學(xué)都不遲。

作者: socl 時(shí)間: 2021-7-9 14:18
只能說各有各的好

作者: wwx123456 時(shí)間: 2021-7-10 11:58
目前大學(xué)小白，單片機(jī)和FPGA都在用，C語言，C++也都學(xué)過。感覺自己通信這個(gè)方向，使用FPGA也是越來越順手，他很多數(shù)字實(shí)現(xiàn)的功能確實(shí)很方便

作者: liling20089 時(shí)間: 2021-7-11 08:58
既然入了這一行，學(xué)點(diǎn)沒壞處，廣泛涉略吧，不用看得太嚴(yán)肅

作者: 五福臨門 時(shí)間: 2021-7-11 21:25

為了RMB，沒RMB一切都是扯蛋,這就是最大的意義！

作者: rayin 時(shí)間: 2021-7-14 08:44
Verilog像極了c語言，二者同步學(xué)都沒問題的，都有用，低成本的應(yīng)用還是單片機(jī)多。

作者: child955 時(shí)間: 2021-7-14 16:53
還可以吧，很多大學(xué)也會(huì)開設(shè)這個(gè)課程，反正學(xué)知識(shí)沒壞處

作者: chaihznehau 時(shí)間: 2021-7-14 19:19
VHDL是硬件設(shè)計(jì)軟件編程化的重要工具，由VHDL語言你可以深刻了解主控各底層驅(qū)動(dòng)的工作機(jī)理，對(duì)硬件驅(qū)動(dòng)將會(huì)有非常深刻的了解，促進(jìn)作者對(duì)嵌入式驅(qū)動(dòng)程序的快速接入和問題解決。

作者: wujin0731 時(shí)間: 2021-10-24 09:22
做ICVHDL等硬件描繪語言很有用啊

作者: 996256177 時(shí)間: 2021-11-1 17:42
好好學(xué)就行了，要啥子意義

作者: 微梟 時(shí)間: 2021-12-3 09:03
VHDL我這學(xué)期學(xué)了，是在EDA課學(xué)的，還是比較枯燥的

作者: lixiangyu811 時(shí)間: 2021-12-3 09:52
vhdl具有多層次的電路設(shè)計(jì)描述功能，即可描述系統(tǒng)級(jí)電路也可描述入門級(jí)電路，主要應(yīng)用于fpga和eda技術(shù) eda又稱芯片之母，目前這方面人才缺口大待遇也不錯(cuò)

作者: npn 時(shí)間: 2021-12-9 11:12
很多書上講的都是 Verilog HDL 而且用的人多，沒學(xué)過VHDL。

作者: wing_s 時(shí)間: 2021-12-9 11:33
每一行都有它的發(fā)光點(diǎn)，喜歡就學(xué)，畢竟學(xué)無止境

作者: heng666 時(shí)間: 2021-12-9 13:41
有意思

作者: TTQ001 時(shí)間: 2021-12-11 10:44
學(xué)習(xí)VHDL是非常有趣和有用的。

作者: gdwin 時(shí)間: 2021-12-11 17:14
VHDL 也就是 Verilog HDL語言，主要用做芯片設(shè)計(jì)！一般是芯片的IP軟核交付的那種文本文件，就是用VHDL設(shè)計(jì)的。而這類設(shè)計(jì)沒法用c語言做！

作者: 我愛你51 時(shí)間: 2021-12-11 20:04
蘿卜白菜各有所愛，但學(xué)習(xí)的知識(shí)絕對(duì)有用

作者: hamster1 時(shí)間: 2021-12-11 20:42
行行出狀元，沒有不行的學(xué)科，只有不行的人...我就是不行的人

作者: 何寶貝 時(shí)間: 2021-12-15 08:35
都是軟件工具各有各的優(yōu)點(diǎn)

作者: bigbigcong 時(shí)間: 2021-12-15 09:28
我的天？？都有外孫女了？

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