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標(biāo)題: 關(guān)于FPGA異時鐘域數(shù)據(jù)采集涉及到的亞穩(wěn)態(tài)問題,到底是哪種方法靠譜? [打印本頁]

作者: donghaidadao    時間: 2018-9-11 14:21
標(biāo)題: 關(guān)于FPGA異時鐘域數(shù)據(jù)采集涉及到的亞穩(wěn)態(tài)問題,到底是哪種方法靠譜?
關(guān)于FPGA異時鐘域數(shù)據(jù)采集涉及到的亞穩(wěn)態(tài)問題,到底是哪種方法靠譜

作者: mmssll    時間: 2018-9-12 22:13
打多拍,這個是高級工程師親口說的,說白了就是加幾個D觸發(fā)器作緩沖,過濾毛刺,缺點就是數(shù)據(jù)延遲幾個時鐘周期,這就需要你寫代碼的時候調(diào)整一下了




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